Welcome to the 1024:10 Priority Encoder physical design project! This repository documents the complete journey of a massive 1024-input digital macro, from behavioral Verilog code to a fully routed, ...
学生の時に設計してみたかったハードウェアJPEGエンコーダーを設計してみよう。使用言語はVerilog、Google DSLX、Pythonなど。 3モジュール並列に置き、並列動作させます。 設計言語はDSLXで各処理を記述した後にVerilogで全体を組み立て。 →BMPファイルをJPEG ...
For my Senior Design project I am working with four others on a FPGA implementation of the ITU G.729 Encoder. We are writing the encoder in verilog code and building it onto a Xilinx Virtex-5 board.
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